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嵌入式工控机嵌入式系统中DRAM控制器的CPLD解决方案

blog 2020-11-04 12 0

  需要大容量存储器的情况下,这种方式将使成本猛增。如果采用DRAM存储器,则可以大幅度降低

  为了方便地使用DRAM,降低系统成本,本文提出一种新颖的解决方案:利用80C186XL的时序特征,采用CPLD技术,并使用VHDL语言设计实现DRAM控制器。

  80C186XL的BIU单元提供20位地址总线,无风扇工控机,RCU单元也为刷新周期提供20位地址总线XL能够产生刷新功能,并将刷新状态编码到控制信号中。

  图1是RCU单元的方框图。它由1个9位递减定时计数器、1个9位地址计数器、嵌入式工控机,3个控制寄存器和接口逻辑组成。当RCU使能时,递减定时计数器每一个CLKOUT周期减少1次,定时计数器的值减为1时,则产生刷新总线请求,递减定时计数器重载,操作继续。刷新总线XL总线有空,就执行刷新操作。

  设计者可将刷新总线周期看成是“伪读”周期。刷新周期像普通读周期一样出现在80C186XL总线上,只是没有数据传输。从引脚BHE/RFSH和A0的状态可以判别刷新周期,如表1所列。刷新总线 刷新周期的引脚状态

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